电路设计中如何防止静电放电?

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【导读】我们的手都曾有过静电放电(ESD)的体验，即使只是从地毯上走过然后触摸某些金属部件也会在瞬间释放积累起来的静电。我们许多人都曾抱怨在实验室中使用导电毯、ESD静电腕带和其它要求来满...

我们的手都曾有过静电放电(ESD)的体验，即使只是从地毯上走过然后触摸某些金属部件也会在瞬间释放积累起来的静电。我们许多人都曾抱怨在实验室中使用导电毯、ESD静电腕带和其它要求来满足工业ESD标准。我们中也有不少人曾经因为粗心大意使用未受保护的电路而损毁昂贵的电子元件。

对某些人来说ESD是一种挑战，因为需要在处理和组装未受保护的电子元件时不能造成任何损坏。这是一种电路设计挑战，因为需要保证系统承受住ESD的冲击，之后仍能正常工作，更好的情况是经过ESD事件后不发生用户可觉察的故障。

与人们的常识相反，设计人员完全可以让系统在经过ESD事件后不发生故障并仍能继续运行。将这个目标谨记在心，下面让我们更好地理解ESD冲击时到底发生了什么，然后介绍如何设计正确的系统架构来应对ESD。

简单模型

将一个电容充电到高电压(一般是2kV至8kV)，然后通过闭合开关将电荷释放进准备承受ESD冲击的“受损”器件(图1)。电荷的极性可以是正也可以是负，因此必须同时处理好正负ESD两种情况。

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2004-09-14 09:23:06

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