电气高手们，帮忙设计个数字频率计！！！急啊！

m1599511561 2009-01-02 11:01:23 348 浏览

要求：脉冲信号的频率就是在单位时间内所产生的脉冲个数，其表达式为 f＝N／T，其中f为被测信号的频率，N为计数器所累计的脉冲个数，T为产生N个脉冲所需的时间。计数器所记录的结果，就是被测信号的频率。如在1S内记录1000个脉冲，则被测信号的频率为1000... 要求：脉冲信号的频率就是在单位时间内所产生的脉冲个数，其表达式为 f＝N／T，其中f为被测信号的频率，N为计数器所累计的脉冲个数，T为产生N个脉冲所需的时间。计数器所记录的结果，就是被测信号的频率。如在1S内记录1000个脉冲，则被测信号的频率为1000Hz。晶振产生较高的标准频率，经分频器后可获得各种时基脉冲（1ms，10ms，0.1s，1s等），时基信号的选择由开关S2控制。被测频率的输入信号经放大整形后变成矩形脉冲加到主控门的输入端，如果被测信号为方波，放大整形可以不要，将被测信号直接加到主控门的输入端。时基信号经控制电路产生闸门信号至主控门，只有在闸门信号采样期间内（时基信号的一个周期），输入信号才通过主控门。若时基信号的周期为T，进入计数器的输入脉冲数为N，则被测信号的频率f＝N / T，改变时基信号的周期T，即可得到不同的测频范围。当主控门关闭时，计数器停止计数，显示器显示记录结果。此时控制电路输出一个置零信号，经延时、整形电路的延时，当达到所调节的延时时间时，延时电路输出一个复位信号，使计数器和所有的触发器置0，为后续新的一次取样作好准备，即能锁住一次显示的时间，使保留到接受新的一次取样为止。当开关S2改变量程时，小数点能自动移位。若开关S1，S3配合使用，可将测试状态转为“自检”工作状态（即用时基信号本身作为被测信号输入）。使用中、小规模集成电路设计与制作一台简易的数字频率计。应具有下述功能： 1、位数计4位十进制数计数位数主要取决于被测信号频率的高低，如果被测信号频率较高，精度又较高，可相应增加显示位数。 2、量程 diyi档：Z小量程档，Z大读数是9.999KHz，闸门信号的采样时间为1s。第二档：Z大读数为99.99KHz，闸门信号的采样时间为0.1s。第三档：Z大读数为999.9KHz，闸门信号的采样时间为10ms。第四档：Z大读数为9999KHz，闸门信号的采样时间为1ms。 3、显示方式 (1)用七段LED数码管显示读数，做到显示稳定、不跳变。 (2)小数点的位置跟随量程的变更而自动移位。 (3)为了便于读数，要求数据显示的时间在0.5s～5s内连续可调。 4、具有“自检”功能。 5、被测信号为方波信号。 6、画出设计的数字频率计的电路总图。 7、组装和调试展开

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情商Nx31qz1 2009-01-03 00:00:00

我只知道用单片机来实现很简单，用小规模集成电路你自己找电器系的吧

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奥运37 2009-01-13 00:00:00

晶振产生较高的标准频率，经分频器后可获得各种时基脉冲（1ms，10ms，0.1s，1s等），时基信号的选择由开关S2控制。被测频率的输入信号经放大整形后变成矩形脉冲加到主控门的输入端，如果被测信号为方波，放大整形可以不要，将被测信号直接加到主控门的输入端。时基信号经控制电路产生闸门信号至主控门，只有在闸门信号采样期间内（时基信号的一个周期），输入信号才通过主控门。若时基信号的周期为T，进入计数器的输入脉冲数为N，则被测信号的频率f＝N / T，改变时基信号的周期T，即可得到不同的测频范围。当主控门关闭时，计数器停止计数，显示器显示记录结果。此时控制电路输出一个置零信号，经延时、整形电路的延时，当达到所调节的延时时间时，延时电路输出一个复位信号，使计数器和所有的触发器置0，为后续新的一次取样作好准备，即能锁住一次显示的时间，使保留到接受新的一次取样为止。

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电气高手们，帮忙设计个数字频率计！！！急啊！: 要求：脉冲信号的频率就是在单位时间内所产生的脉冲个数，其表达式为 f＝N／T，其中f为被测信号的频率，N为计数器所累计的脉冲个数，T为产生N个脉冲所需的时间。计数器所记录的结果，就是被测信号的频率。如在1S内记录1000个脉冲，则被测信号的频率为1000... 要求：脉冲信号的频率就是在单位时间内所产生的脉冲个数，其表达式为 f＝N／T，其中f为被测信号的频率，N为计数器所累计的脉冲个数，T为产生N个脉冲所需的时间。计数器所记录的结果，就是被测信号的频率。如在1S内记录1000个脉冲，则被测信号的频率为1000Hz。晶振产生较高的标准频率，经分频器后可获得各种时基脉冲（1ms，10ms，0.1s，1s等），时基信号的选择由开关S2控制。被测频率的输入信号经放大整形后变成矩形脉冲加到主控门的输入端，如果被测信号为方波，放大整形可以不要，将被测信号直接加到主控门的输入端。时基信号经控制电路产生闸门信号至主控门，只有在闸门信号采样期间内（时基信号的一个周期），输入信号才通过主控门。若时基信号的周期为T，进入计数器的输入脉冲数为N，则被测信号的频率f＝N / T，改变时基信号的周期T，即可得到不同的测频范围。当主控门关闭时，计数器停止计数，显示器显示记录结果。此时控制电路输出一个置零信号，经延时、整形电路的延时，当达到所调节的延时时间时，延时电路输出一个复位信号，使计数器和所有的触发器置0，为后续新的一次取样作好准备，即能锁住一次显示的时间，使保留到接受新的一次取样为止。当开关S2改变量程时，小数点能自动移位。若开关S1，S3配合使用，可将测试状态转为“自检”工作状态（即用时基信号本身作为被测信号输入）。使用中、小规模集成电路设计与制作一台简易的数字频率计。应具有下述功能： 1、位数计4位十进制数计数位数主要取决于被测信号频率的高低，如果被测信号频率较高，精度又较高，可相应增加显示位数。 2、量程 diyi档：Z小量程档，Z大读数是9.999KHz，闸门信号的采样时间为1s。第二档：Z大读数为99.99KHz，闸门信号的采样时间为0.1s。第三档：Z大读数为999.9KHz，闸门信号的采样时间为10ms。第四档：Z大读数为9999KHz，闸门信号的采样时间为1ms。 3、显示方式 (1)用七段LED数码管显示读数，做到显示稳定、不跳变。 (2)小数点的位置跟随量程的变更而自动移位。 (3)为了便于读数，要求数据显示的时间在0.5s～5s内连续可调。 4、具有“自检”功能。 5、被测信号为方波信号。 6、画出设计的数字频率计的电路总图。 7、组装和调试展开

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Verilog 数字频率计设计: 要求LED显示频率为0到999HZ

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